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作者:"周润景, 李志, 张玉光"
出版年:"20180101"
基于Quartus Prime的数字系统Verilog HDL设计实例详解
:周润景, 李志, 张玉光
作者：
周润景, 李志, 张玉光
出版社：
电子工业出版社
出版时间：
20180101
ISBN：
978-7-121-34898-3
索书号：
TP301.2/15\3
分类号：
TP301.2
页数：
460页
价格：
CNY99.00
复本数：
在馆数：
累借天数：
累借次数：
本书以语法与实例结合的方式来讲解可编程逻辑器件的设计方法, 软件开发平台为Altera公司的QuartusPrime16.1FPGA/CPLD设计软件。本书由浅入深地介绍了利用QuartusPrime进行数字系统开发的设计流程、设计思想和设计技巧。书中的例子非常丰富, 既有简单的数字逻辑电路实例, 也有复杂的数字系统设计实例。
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文献类型
中文图书
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出版社
电子工业出版社
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作者
周润景, 李志, 张玉光
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